一个四级的Mux,其中第二级信号为关键信号如何改善timing。（威盛VIA
2003.11.06 上海笔试试题）
说说静态、动态时序模拟的优缺点。（威盛VIA 2003.11.06 上海笔试试题）
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一个四级的Mux,其中第二级信号为关键信号如何改善timing。（威盛VIA2003.11.06上海笔试试题）
卡诺图写出逻辑表达使。（威盛VIA 2003.11.06 上海笔试试题）
画出CMOS的图，画出tow-to-one mux gate。（威盛VIA 2003.11.06 上海笔试试题）
用逻辑们画出D触发器。（威盛VIA 2003.11.06 上海笔试试题）
Asic的design flow。（威盛VIA 2003.11.06 上海笔试试题）
cache的主要部分什么的。（威盛VIA 2003.11.06 上海笔试试题）
